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Optimization and Verification of Current-Mode Multiple-Valued Digit ORNS Arithmetic Circuits Optimisation et vérification des circuits arithmétiques ORNS à chiffres multiples en mode courant

Motoi INABA, Koichi TANNO, Hiroki TAMURA, Okihiko ISHIZUKA

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Résumé:

Dans cet article, l'optimisation et la vérification des circuits arithmétiques ORNS à chiffres à valeurs multiples en mode courant sont présentées. L'ORNS à chiffres à valeurs multiples est le système numérique redondant utilisant des valeurs de chiffres dans la logique à valeurs multiples et il réalise le calcul entièrement parallèle sans aucune propagation de report d'ondulation. Premièrement, les algorithmes d'addition et de multiplication sur 4 bits utilisant l'ORNS à chiffres à valeurs multiples sont optimisés grâce à des analyses de niveau logique. Dans le multiplicateur, la valeur numérique maximale et le nombre d'opérations modulo en série sont réduits avec succès de 49 à 29 et de 3 à 2, respectivement, grâce à la disposition des lignes d'addition. Ensuite, les composants du circuit tels qu'un miroir de courant sont vérifiés à l'aide de HSPICE. Le miroir de courant commuté proposé, qui possède des fonctions de miroir de courant et de commutateur analogique, est efficace pour réduire la tension de fonctionnement minimale d'environ 0.13 volt. Outre une région ordinaire de forte inversion, les composants du circuit fonctionnant dans la région de faible inversion montrent de bons résultats de simulation avec un courant unitaire de 10 nanoampères, et cela apporte à la fois une dissipation de puissance plus faible et un fonctionnement stable sous une tension d'alimentation plus faible.

Publication
IEICE TRANSACTIONS on Information Vol.E93-D No.8 pp.2073-2079
Date de publication
2010/08/01
Publicisé
ISSN en ligne
1745-1361
DOI
10.1587/transinf.E93.D.2073
Type de manuscrit
Special Section PAPER (Special Section on Multiple-Valued Logic and VLSI Computing)
Catégories
Technologie VLSI à valeurs multiples

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