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HDLs Modeling Technique for Burst-Mode and Extended Burst-Mode Asynchronous Circuits Technique de modélisation HDL pour les circuits asynchrones en mode rafale et en mode rafale étendu

Jung-Lin YANG, Jau-Cheng WEI, Shin-Nung LU

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Résumé:

Une technique de modélisation basée sur les langages de description matérielle (HDL) pour les circuits asynchrones est présentée dans cet article. Un package de prise de contact HDL a été développé pour exprimer des systèmes numériques de type poignée de main en VHDL et Verilog. Des circuits en mode rafale et en mode rafale étendu (BM/XBM) ont été utilisés pour démontrer l’utilité de ce travail. Cette recherche a permis de prototyper avec succès des comparateurs, des additionneurs, un encodeur/décodeur RSA et plusieurs circuits auto-temporisés pour les conceptions de circuits intégrés et de FPGA entièrement personnalisés. De plus, le package de prise de contact HDL mis en œuvre par cette recherche peut être utilisé pour développer des bancs de tests comportementaux pour étudier et analyser des conceptions asynchrones. L'extraction d'informations de synchronisation détaillées à partir de machines à états finis asynchrones (AFSM), la détection de défauts de retard pour les modules fonctionnels synthétisés à temporisation automatique et la localisation de violations de mode fondamental dans les AFSM réalisés sont des applications éprouvées. La technique de modélisation HDL anticipée et la procédure de transformation sont détaillées dans la suite de cet article.

Publication
IEICE TRANSACTIONS on Fundamentals Vol.E93-A No.12 pp.2590-2599
Date de publication
2010/12/01
Publicisé
ISSN en ligne
1745-1337
DOI
10.1587/transfun.E93.A.2590
Type de manuscrit
Special Section PAPER (Special Section on VLSI Design and CAD Algorithms)
Catégories
Synthèse de haut niveau et conception au niveau du système

Auteurs

Mots-clés

Table des matières