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VLSI Implementation of a VC-1 Main Profile Decoder for HD Video Applications Implémentation VLSI d'un décodeur de profil principal VC-1 pour les applications vidéo HD

Jinhyun CHO, Doowon LEE, Sangyong YOON, Sanggyu PARK, Soo-Ik CHAE

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Résumé:

Dans cet article, nous présentons un décodeur de profil principal VC-1 hautes performances pour les applications vidéo haute définition (HD), capable de décoder les flux vidéo HD 720p à 30 ips à 80 MHz. Nous avons implémenté le décodeur avec un processus CMOS un poly huit métaux de 0.13 µm, qui contient environ 261,900 13.9 portes logiques et des mémoires sur puce de 13.1 Ko de SRAM et 5.1 Ko de ROM et occupe une superficie d'environ XNUMX mm.2. Lors de la conception du décodeur VC-1, nous avons utilisé un flux de conception SoC basé sur un modèle, avec lequel nous avons effectué l'exploration de l'espace de conception du décodeur en essayant diverses configurations de canaux de communication. De plus, nous décrivons également des architectures de blocs de calcul optimisées pour satisfaire les exigences des applications VC-1 HD.

Publication
IEICE TRANSACTIONS on Fundamentals Vol.E92-A No.1 pp.279-290
Date de publication
2009/01/01
Publicisé
ISSN en ligne
1745-1337
DOI
10.1587/transfun.E92.A.279
Type de manuscrit
PAPER
Catégories
Technologie de conception VLSI et CAO

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