La fonctionnalité de recherche est en construction.
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Implementation and Area Optimization of LUT6 Based Convolution Structure on FPGA Implémentation et optimisation de zone de la structure de convolution basée sur LUT6 sur FPGA

Huangtao WU, Wenjin HUANG, Rui CHEN, Yihua HUANG

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Résumé:

Pour mettre en œuvre l'accélération parallèle du fonctionnement de convolution des réseaux de neurones convolutifs (CNN) sur des réseaux de portes programmables par l'utilisateur (FPGA), de grandes quantités de ressources logiques seront consommées, en particulier les cœurs DSP. De nombreuses recherches antérieures ne parviennent pas à établir un bon équilibre entre DSP et LUT6. Pour une meilleure efficacité des ressources, une structure de convolution typique est implémentée avec les LUT6 dans cet article. En outre, une nouvelle structure de convolution est proposée pour réduire davantage la consommation de ressources LUT6 en modifiant la structure de convolution typique. Les équations permettant d'évaluer les consommations de ressources LUT6 des deux structures sont présentées et validées. L'évaluation théorique et les résultats expérimentaux montrent que la nouvelle structure peut économiser 3.5 à 8 % des LUT6 par rapport à la structure typique.

Publication
IEICE TRANSACTIONS on Fundamentals Vol.E102-A No.12 pp.1813-1815
Date de publication
2019/12/01
Publicisé
ISSN en ligne
1745-1337
DOI
10.1587/transfun.E102.A.1813
Type de manuscrit
Special Section LETTER (Special Section on VLSI Design and CAD Algorithms)
Catégories

Auteurs

Huangtao WU
  Sun Yat-sen University
Wenjin HUANG
  Sun Yat-sen University
Rui CHEN
  Sun Yat-sen University
Yihua HUANG
  Sun Yat-sen University

Mots-clés

Table des matières