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Hardware Implementation of the High-Dimensional Discrete Torus Knot Code Implémentation matérielle du code de nœud de tore discret de grande dimension

Yuuichi HAMASUNA, Masanori YAMAMURA, Toshio ISHIZAKA, Masaaki MATSUO, Masayasu HATA, Ichi TAKUMI

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Résumé:

L'implémentation matérielle d'un code de nœud de tore discret de haute dimension proposé a été réalisée avec succès sur une puce ASIC. Le code a été élaboré pendant plus d'une décennie à l'Université préfectorale d'Aichi et aux instituts de technologie de Nagoya, tous deux situés à Nagoya, au Japon. Le fonctionnement du matériel a montré la capacité de corriger les erreurs environ cinq à dix fois plus longues que les codes conventionnels, comme prévu par la configuration et la théorie du code. Le résultat en matière de correction d'erreurs aléatoires était également excellent, en particulier pour une plage de taux d'erreur gravement dégradée allant du centième au dixième, ainsi que pour des caractéristiques de qualité supérieure dépassant 10.-6. L'opération était assez stable au pire taux d'erreur binaire et atteignait une vitesse élevée allant jusqu'à 50 Mbps, puisque la configuration codeur-décodeur consistait simplement en un assemblage de code de contrôle de parité et de circuits matériels sans chemin de boucle critique. L'architecture matérielle a une configuration unique et convient à la conception d'ASIC à grande échelle. Le code développé peut être utilisé pour des applications plus larges telles que l'informatique mobile et les communications numériques qualifiées, car il devrait fonctionner correctement dans des situations de canaux dégradés et de haute qualité.

Publication
IEICE TRANSACTIONS on Fundamentals Vol.E84-A No.4 pp.949-956
Date de publication
2001/04/01
Publicisé
ISSN en ligne
DOI
Type de manuscrit
Special Section PAPER (Special Section on Fundamentals of Information and Communications)
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