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A Second-Order Sigma-Delta Modulator with a Gain Scaling of ADC and a Simple Multibit DAC Un modulateur Sigma-Delta de second ordre avec une mise à l'échelle du gain de l'ADC et un DAC multibit simple

Byung-Woog CHO, Pyung CHOI, Jun-Rim CHOI, Dae-Hyuk KWON, Byung-Ki SOHN

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Résumé:

Un modulateur sigma-delta de second ordre avec un quantificateur interne de 3 bits doté d'une mise à l'échelle du gain d'un CAN interne et d'un DAC interne très simple a été conçu et implémenté dans un processus CMOS double poly double métal de 0.8 µm. Nous avons amélioré les performances du modulateur grâce à la mise à l'échelle du gain d'un CAN interne 3 bits et à la conception du DAC interne sans erreur en utilisant de simples portes logiques. La spécification de chaque composant est déterminée pour que le modulateur ait une résolution de 14 bits par modélisation basée sur le temps et les composants conçus satisfont aux spécifications requises. Le SNR maximal de 87 dB et la plage dynamique de 87 dB ont été atteints à une fréquence d'horloge de 2.816 MHz pour une bande de base de 22 kHz. Les résultats mesurés montrent que le modulateur fabriqué abaisse le SNR de 14 dB par rapport à celui de la simulation en raison de la source d'entrée non idéale et des facteurs d'erreur ignorés dans la modélisation tels que les condensateurs variables en tension, etc.

Publication
IEICE TRANSACTIONS on Fundamentals Vol.E83-A No.6 pp.1192-1198
Date de publication
2000/06/25
Publicisé
ISSN en ligne
DOI
Type de manuscrit
PAPER
Catégories
Traitement du signal analogique

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