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Improving Dictionary-Based Code Compression in VLIW Architectures Amélioration de la compression de code basée sur un dictionnaire dans les architectures VLIW

Sang-Joon NAM, In-Cheol PARK, Chong-Min KYUNG

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Résumé:

La réduction de la taille du code est cruciale dans les systèmes embarqués ainsi que dans les systèmes hautes performances pour surmonter le goulot d'étranglement de communication entre la mémoire et le CPU, en particulier avec les processeurs VLIW (Very Long Instruction Word) qui nécessitent une prélecture des instructions à large bande passante. Cet article présente une nouvelle approche pour la compression de code basée sur un dictionnaire dans les systèmes basés sur un processeur VLIW utilisant l'isomorphisme entre les mots d'instruction. Après avoir divisé les mots d'instruction en deux groupes, l'un pour le groupe d'opcodes et l'autre pour le groupe d'opérandes, l'algorithme de compression proposé est appliqué à chaque groupe pour une compression maximale du code. Les mots d'instruction fréquemment utilisés sont extraits du code original pour être mappés dans deux dictionnaires, un dictionnaire d'opcodes et le dictionnaire d'opérandes. Selon les benchmarks SPEC95, la technique proposée a atteint un taux de compression de code moyen de 63 %, 69 % et 71 % dans une architecture VLIW à 4 numéros, 8 numéros et 12 numéros, respectivement.

Publication
IEICE TRANSACTIONS on Fundamentals Vol.E82-A No.11 pp.2318-2324
Date de publication
1999/11/25
Publicisé
ISSN en ligne
DOI
Type de manuscrit
Special Section PAPER (Special Section on VLSI Design and CAD Algorithms)
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