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A 158 MS/s JPEG 2000 Codec with a Bit-Plane and Pass Parallel Embedded Block Coder for Low Delay Image Transmission Un codec JPEG 158 de 2000 MS/s avec un codeur par blocs intégré à plan binaire et passe parallèle pour une transmission d'images à faible délai

Masayuki MIYAMA, Yuusuke INOIE, Takafumi KASUGA, Ryouichi INADA, Masashi NAKAO, Yoshio MATSUDA

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Résumé:

Cet article décrit un codec JPEG 158 à 2000 MS/s avec un codeur par blocs intégré (EBC) basé sur une architecture à plan binaire et à passes parallèles. L'EBC contient des codeurs de plan binaire (BPC) correspondant à chaque plan binaire dans un bloc de code. Les codages des plans de bits supérieur et inférieur se chevauchent dans le temps avec un espacement à 1 bande et à 1 colonne. Les passes de modélisation binaire dans le codage du plan binaire se chevauchent également dans le temps avec le même intervalle. Ces méthodes augmentent le débit de 30 fois par rapport aux méthodes conventionnelles. De plus, les procédés prennent en charge non seulement le mode causal vertical, mais également le mode régulier, qui améliore la qualité de l'image. De plus, un décodage spéculatif est adopté pour augmenter le débit. Ce codec LSI a été conçu selon un procédé de 0.18 µm. La zone centrale est de 4.74.7 mm2 et la fréquence est de 160 MHz. Un système incluant le codec permet la transmission d'images du bureau du PC avec un délai de 8 ms.

Publication
IEICE TRANSACTIONS on Fundamentals Vol.E91-A No.8 pp.2025-2034
Date de publication
2008/08/01
Publicisé
ISSN en ligne
1745-1337
DOI
10.1093/ietfec/e91-a.8.2025
Type de manuscrit
Special Section PAPER (Special Section on Signal Processing)
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