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A Low Jitter Self-Calibration PLL for 10-Gbps SoC Transmission Links Application Une PLL d'auto-étalonnage à faible gigue pour les applications de liaisons de transmission SoC 10 Gbit/s

Kuo-Hsing CHENG, Yu-Chang TSAI, Chien-Nan Jimmy LIU, Kai-Wei HONG, Chin-Cheng KUO

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Résumé:

Une boucle à verrouillage de phase (PLL) à 2.5 phases de 8 GHz est proposée pour les applications de liaisons de transmission de système sur puce (SoC) à 10 Gbit/s. La PLL proposée possède plusieurs fonctionnalités qui utilisent de nouvelles techniques de conception. La première est une nouvelle cellule à retard variable (VDC) pour l'oscillateur à commande de tension (VCO). Ses avantages par rapport à la cellule à retard conventionnelle sont : une fréquence de sortie à large plage et une faible sensibilité au bruit avec un faible KVCO. La deuxième caractéristique est que la PLL se compose d'un circuit d'auto-étalonnage (SCC) qui protège la PLL des variations du processus, de la tension et de la température (PVT). La troisième caractéristique est que la PLL proposée a une fréquence de sortie à 8 phases et également, pour éviter l'effet puissance/terre (P/G) et l'effet de bruit du substrat sur la PLL, elle a également une faible fréquence de sortie de gigue. La PLL est implémentée en technologie CMOS 0.13 µm. La gigue de sortie PLL est de 2.83 ps (rms), soit moins de 0.7 % de la période de sortie. La dissipation de puissance totale est de 21 mW à une fréquence de sortie de 2.5 GHz et la zone centrale est de 0.08 mm.2.

Publication
IEICE TRANSACTIONS on Electronics Vol.E92-C No.7 pp.964-972
Date de publication
2009/07/01
Publicisé
ISSN en ligne
1745-1353
DOI
10.1587/transele.E92.C.964
Type de manuscrit
PAPER
Catégories
Électronique intégrée

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