La fonctionnalité de recherche est en construction.
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A 300 MHz Embedded Flash Memory with Pipeline Architecture and Offset-Free Sense Amplifiers for Dual-Core Automotive Microcontrollers Une mémoire flash intégrée de 300 MHz avec une architecture pipeline et des amplificateurs de détection sans décalage pour les microcontrôleurs automobiles double cœur

Shinya KAJIYAMA, Masamichi FUJITO, Hideo KASAI, Makoto MIZUNO, Takanori YAMAGUCHI, Yutaka SHINAGAWA

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Résumé:

Une nouvelle mémoire flash intégrée de 300 MHz pour microcontrôleurs double cœur avec une architecture ROM partagée est proposée. L'une de ses fonctionnalités est une opération de lecture de pipeline en trois étapes, qui permet de réduire le pas d'accès et donc de réduire les pénalités de performances dues aux conflits d'accès à la ROM partagée. Une autre caractéristique est un amplificateur de détection très sensible qui permet un fonctionnement efficace du pipeline avec un pas d'un cycle de latence à deux cycles grâce à un temps de détection raccourci de 0.63 ns. La combinaison de l'architecture pipeline et des amplificateurs de détection proposés réduit considérablement les pénalités de conflit d'accès avec la ROM partagée et améliore de 32 % les performances des microcontrôleurs double cœur RISC 30 bits.

Publication
IEICE TRANSACTIONS on Electronics Vol.E92-C No.10 pp.1258-1264
Date de publication
2009/10/01
Publicisé
ISSN en ligne
1745-1353
DOI
10.1587/transele.E92.C.1258
Type de manuscrit
Special Section PAPER (Special Section on Hardware and Software Technologies on Advanced Microprocessors)
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