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A 10-bit 3-Msample/s CMOS Multipath Multibit Cyclic ADC Un CAN cyclique multibits à trajets multiples CMOS 10 bits à 3 Méchantillons/s

Tatsuji MATSUURA, Akihiro KITAGAWA, Toshiro TSUKADA, Eiki IMAIZUMI

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Résumé:

Un convertisseur A/N cyclique multibit 10 bits 3 Méch./s pour les LSI à signaux mixtes avec une petite zone de puce de 1.5 mm2 et une faible consommation d'énergie de 10.8 mW avec une alimentation de 2.7 V a été réalisée à l'aide d'un processus CMOS de 0.8 µm. Ce module ADC est conçu pour les LSI de servocontrôleur haute vitesse utilisés dans les systèmes de disque dur. Nous avons constaté que la conversion cyclique à trois cycles (quatre bits, trois bits+(un bit redondant) et trois bits+(un bit redondant)) était optimale pour atteindre une résolution de 10 bits avec une petite zone de puce et une faible consommation d'énergie compte tenu de la résolution requise. temps de conversion de 0.33 µs. Notre architecture multivoies a réduit la consommation d'énergie de 30 % par rapport aux convertisseurs A/D cycliques classiques. En ajoutant un chemin de signal entre l'amplificateur résiduel et le subADC à quatre bits, l'exigence de synchronisation de stabilisation peut être assouplie et la consommation électrique de l'amplificateur ainsi réduite.

Publication
IEICE TRANSACTIONS on Electronics Vol.E83-C No.2 pp.227-235
Date de publication
2000/02/25
Publicisé
ISSN en ligne
DOI
Type de manuscrit
Special Section PAPER (Special Issue on Low-Power High-Speed CMOS LSI Technologies)
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