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Ultra Dependable Processor Processeur ultra fiable

Shuichi SAKAI, Masahiro GOSHIMA, Hidetsugu IRIE

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Résumé:

Cet article présente l'architecture du processeur qui offre un niveau de fiabilité bien supérieur à celui actuel. Ses caractéristiques sont les suivantes : (1) la tolérance aux pannes et le traitement sécurisé sont intégrés dans un processeur VLSI superscalaire moderne ; (2) des mécanismes légers et efficaces tolérants aux erreurs logicielles sont proposés et évalués ; (3) les erreurs de synchronisation sur la logique aléatoire et les registres sont évitées par des mécanismes à faible surcharge ; (4) le comportement du programme est caché au monde extérieur par les méthodes de traduction d'adresse proposées ; (5) les fuites d'informations peuvent être évitées en attachant des balises de stratégie pour toutes les données et en les surveillant pour chaque exécution d'instruction ; (6) les attaques par injection sont évitées avec une précision beaucoup plus élevée que les systèmes actuels, en fournissant un suivi des balises ; (7) la structure globale du processeur fiable est proposée avec un responsable de la fiabilité qui contrôle la détection de conditions illégales et revient au mode normal ; et (8) un système de banc d'essai basé sur FPGA est développé dans lequel l'horloge système et la tension sont intentionnellement modifiées à des fins d'expérimentation. L'article présente le schéma fondamental de la fiabilité, les technologies élémentaires pour la fiabilité et l'architecture entière du processeur ultra fiable. Après les avoir montrés, l'article se termine par les travaux futurs.

Publication
IEICE TRANSACTIONS on Electronics Vol.E91-C No.9 pp.1386-1393
Date de publication
2008/09/01
Publicisé
ISSN en ligne
1745-1353
DOI
10.1093/ietele/e91-c.9.1386
Type de manuscrit
Special Section INVITED PAPER (Special Section on Advanced Processors Based on Novel Concepts in Computation)
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