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Ethernet Over HDLC Forwarding VLSI for Network Access System Ethernet sur HDLC Forwarding VLSI pour système d'accès réseau

Minsuk HONG, Jinsung OH, Chan Young PARK, Wooseok KANG, Sehyeon RHEE, Sang-Hui PARK

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Résumé:

Dans cet article, nous présentons la conception et la mise en œuvre d’un VLSI de transfert Ethernet sur HDLC rentable pour le système d’accès réseau. Il prend en charge les PHY Ethernet 10/100 Mbps et l'interface HDLC jusqu'à 50 Mbps directement appliquée au modem ou à l'émetteur-récepteur. Le taux de transfert/filtrage maximum est de 90,000 1 pps avec une latence de débit de 0.5 image, ce qui prend en charge les applications à grande vitesse. Il peut également prendre en charge le mode maître pour Ethernet PHY et le mode esclave pour changer de puce par la configuration des broches. Il a été implémenté sous la forme d'une puce unique basée sur la technologie CMOS XNUMX µm. Les tests sur le terrain montrent que le transfert et le traitement des paquets à vitesse filaire grâce à la puce implémentée peuvent être obtenus.

Publication
IEICE TRANSACTIONS on Communications Vol.E85-B No.7 pp.1382-1385
Date de publication
2002/07/01
Publicisé
ISSN en ligne
DOI
Type de manuscrit
LETTER
Catégories
Appareils/Circuits de communication

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